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申请/专利权人：深圳中微电科技有限公司
摘要：本发明公开了一种基于MVP架构的GPU模拟器中高速缓存器存储架构，高速缓存器存储架构为多级结构，所述GPU模拟器中的一级缓存位于单流水线处理单元中并且由所述单流水线处理单元独占，二级缓存位于所述GPU模拟器芯片中并被各图像处理线程共享。各缓存之间直接通过端口传输，所述二级缓存与主存之间通过总线互联。本发明高速缓存器存储架构实现了灵活的多级缓存机制，增添更多可支持配置的高速缓存器逻辑，实现同时执行线程的访存合并，以此减少产生的访存请求，优化并加速访存过程，从而提高了GPU模拟器访问内存的性能。
主权项：1.一种基于MVP架构的GPU模拟器中cache存储架构，其特征在于，所述cache存储架构为多级结构，所述GPU模拟器中的一级缓存位于单流水线处理单元中并且由所述单流水线处理单元独占，二级缓存位于图形处理组与显存芯片之间被所有图像处理组所共享；所述cache存储架构结合Multi-banking技术和sectorcacheline技术，所述Multi-banking作用在数据地址选择进入缓存前，用于减少访问冲突和缓存未命中时修改缓存行的次数；所述sectorcacheline发生在缓存行内，即一条缓存行内各sector块之间地址是连续的，通过sectorcache仅获取缓存行的一部分，用于减少处理未命中的时间和总线流量。
全文数据：
权利要求：
百度查询： 深圳中微电科技有限公司 基于MVP架构的GPU模拟器中高速缓存器存储架构
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