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申请/专利权人：厦门市必易微电子技术有限公司
摘要：本发明提供了一种防止共通的驱动电路，包括第一晶体管、第二晶体管、延时电路、第一充电电路、第一放电电路、第二充电电路和第二放电电路。其中，第一充电电路和第一放电电路分别用于对第一晶体管的控制端进行充电和放电，以分别控制第一晶体管关断和导通，第二充电电路和第二放电电路分别用于对第二晶体管的控制端进行充电和放电，以分别控制第二晶体管关断和导通。延时电路用于对输入信号进行延时处理，当输入信号由低电平转高电平，或由高电平转低电平时，由于对输入信号进行了延时处理，因此第一晶体管和第二晶体管会延时导通，即第一晶体管、第二晶体管在输入信号电平转换阶段都处于关断状态，从而有效避免了共通现象的出现。
主权项：1.一种防止共通的驱动电路，其特征在于，所述驱动电路包括：第一晶体管，所述第一晶体管在其控制端处于低电平状态下导通；第二晶体管，所述第二晶体管在其控制端处于高电平状态下导通；延时电路，用于延时输入信号，生成延时信号；第一充电电路，具有输出端和控制端，其输出端耦接所述第一晶体管的控制端，其控制端耦接所述输入信号，所述第一充电电路用于在所述输入信号处于低电平状态时，对所述第一晶体管的控制端充电；第一放电电路，具有输入端和控制端，其输出端耦接所述第一晶体管的控制端，其控制端耦接所述延时信号，所述第一放电电路用于在所述延时信号处于高电平状态时，对所述第一晶体管的控制端放电；第二充电电路，具有输出端和控制端，其输出端耦接所述第二晶体管的控制端，其控制端耦接所述延时信号，所述第二充电电路用于在所述延时信号处于低电平状态时，对所述第二晶体管的控制端充电；第二放电电路，具有输入端和控制端，其输入端耦接所述第二晶体管的控制端，其控制端耦接所述输入信号，所述第二放电电路用于在所述输入信号处于高电平状态时，对所述第二晶体管的控制端放电；其中，所述第一充电电路的充电电流大于所述第一放电电路的放电电流，所述第二充电电路的充电电流小于所述第二放电电路的放电电流。
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权利要求：
百度查询： 厦门市必易微电子技术有限公司 一种防止共通的驱动电路
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