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申请/专利权人：高通股份有限公司
摘要：一种用于提供低时延频率切换的方法包括以具有第一频率的相同第一时钟信号在第一管芯上运行第一处理组件并且在第二管芯上运行第二处理组件。接收将该第一频率切换到第二、新频率的请求，并产生具有该第二、新频率的第二时钟信号。可停止该第一管芯与该第二管芯之间的数据流。并且随后，将该第二时钟信号发射至管芯接口上的双锁相环架构。根据所组合的第一时钟信号和第二时钟信号创建PCLK信号，并且根据该第二时钟信号创建NCLK信号。接着，对该PCLK信号进行分频并且与该NCLK信号对齐。一旦该PCLK信号与该NCLK信号对齐，便在该两个管芯之间恢复数据流。
主权项：1.一种用于在计算设备内的两个管芯之间提供低时延频率切换的方法，包括：使用第一频率下的第一时钟信号在第一管芯上运行第一处理组件，并且使用所述第一频率下的所述第一时钟信号在第二管芯上运行第二处理组件；生成具有第二、新频率的第二时钟信号；根据所述第一时钟信号和所述第二时钟信号创建具有所述第二、新频率的第三信号；使用管芯接口中的双锁相环架构将所述第一时钟信号与所述第二时钟信号组合；根据由所述双锁相环架构产生的所组合的第一时钟信号和第二时钟信号创建第四信号；以及将所述第四信号的相位与所述第三信号对齐。
全文数据：
权利要求：
百度查询： 高通股份有限公司 用于为管芯到管芯/片上系统（SOC）接口提供低时延快速切换级联双锁相环（PLL）架构的系统
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