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申请/专利权人：爱思开海力士有限公司;韩国科学技术院
摘要：本公开提供一种执行乘法累加运算的非易失性存储器件。非易失性存储器件包括存储单元阵列和计算输出电路。存储单元阵列包括：多个非易失性存储元件，被配置为分别储存多个权重；以及多个位线，根据多个输入信号耦接到多个非易失性存储元件。计算输出电路被配置为根据多个输入信号而从在所述多个位线处引起的电压产生计算信号。
主权项：1.一种非易失性存储器件，包括：存储单元阵列，其包括：多个非易失性存储元件，被配置为分别储存多个权重，以及多个位线，根据多个输入信号而耦接到所述多个非易失性存储元件；计算输出电路，被配置为根据所述多个输入信号而从在所述多个位线处分别引起的电压产生计算信号；以及输入电路，被配置为将所述多个输入信号转换为多个脉冲输入信号，其中，所述存储单元阵列包括：多个单元串，每个单元串包括所述多个非易失性存储元件中的一个；以及多个位线选择开关，所述多个位线选择开关根据所述多个输入信号而将所述多个单元串耦接到所述多个位线，其中，所述多个位线选择开关根据所述多个脉冲输入信号而将所述多个单元串与所述多个位线耦接；以及其中，所述多个脉冲输入信号是其宽度分别与相应的输入信号的值相对应的脉冲信号。
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权利要求：
百度查询： 爱思开海力士有限公司 韩国科学技术院 执行乘法累加运算的非易失性存储器件
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