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申请/专利权人：上海航天测控通信研究所

摘要：本发明公开了一种测量高精度AOS链路网络数据处理延时的方法，包括S1：获取网络数据IP包，并在其UDP数据区插入发送时间码；S2：进行计算校验并送入至AOS链路处理器；S3：抓取AOS帧，并在AOS帧尾部插入接收时间码；S4：依次进行解扰和虚拟信道分包，分成若干路虚拟信道AOS帧，获取虚拟信道信息；S5：进行IP包提取得到相对应的IP信息；S6：进行延时计算得到延时信息；S7：根据虚拟信道信息、IP信息和延时信息形成映射表以显示和分析。采用FPGA硬件，直接抓取底层IP数据和AOS帧数据进行时间码插入，提高实时性，减小对原AOS链路的影响；采用同一个时间基准，提高测量精度；可以精确对每一个虚拟信道、每一种IP的延迟进行实时统计和计算。

主权项：1.一种测量高精度AOS链路网络数据处理延时的方法，其特征在于，包括如下步骤S1：获取网络数据IP包，根据预设协议在所述网络数据IP包的UDP数据区插入发送时间码；S2：向插入所述发送时间码的所述网络数据IP包进行计算校验，并送入至AOS链路处理器；S3：抓取从所述AOS链路处理器输出的AOS帧，并根据预设协议在所述AOS帧尾部插入接收时间码；S4：对插入所述接收时间码的所述AOS帧依次进行解扰和虚拟信道分包，分成若干路虚拟信道AOS帧，从而获取得到相对应的虚拟信道信息；S5：对若干所述路虚拟信道AOS帧进行IP包提取，分别得到相对应的IP信息；S6：对若干所述路虚拟信道AOS帧中的所述发送时间码和所述接收时间码进行延时计算，分别得到延时信息；S7：根据所述虚拟信道信息、所述IP信息和所述延时信息形成映射表，并上传至上位机进行显示和分析；所述网络数据IP包为以太网包，所述步骤S1具体为利用FPGA硬件对接收的网络数据进行底层以太网包的实时抓取，根据预设协议和本地时间在所述网络数据IP包的UDP数据区的固定位置插入所述发送时间码；所述步骤S3具体为利用FPGA硬件对所述AOS帧进行实时抓取，根据预设协议和本地时间在每个AOS帧的尾部固定位置插入所述接收时间码，不改变帧的其他信息；其中，插入的所述接收时间码和所述发送时间码来源于同一个本地时间基准。

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