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申请/专利权人：武汉帆茂电子科技有限公司
摘要：本发明公开了一种基于FPGA的低成本DSC信号产生装置，包括AXIStream并行数据接收模块，所述AXIStream并行数据接收模块用于接收AXIStreamMaster总线上发送的正常图像数据或经过DSC压缩后图像数据，并转换成RGB格式的并行数据；图像数据存储管理模块，所述图像数据存储管理模块存储上述RGB格式的并行数据，并根据待测Displayport模组所需的速率、通道，判断是否支持DSC信息将所述并行数据转化为与所述Displayport模组信号速率匹配的Displayport的串行信号，可以实现在现有装置的基础上可以输出任意分辨率的压缩图像数据，并提供Vcom调节、EDID烧录等功能。
主权项：1.一种基于FPGA的低成本DSC信号产生装置，其特征在于，包括AXIStream并行数据接收模块，所述AXIStream并行数据接收模块用于接收AXIStreamMaster总线上发送的正常图像数据或经过DSC压缩后图像数据，并转换成RGB格式的并行数据；图像数据存储管理模块，所述图像数据存储管理模块存储上述RGB格式的并行数据，并根据待测Displayport模组所需的速率、通道，判断是否支持DSC信息将所述并行数据转化为与所述Displayport模组信号速率匹配的Displayport的串行信号。
全文数据：
权利要求：
百度查询： 武汉帆茂电子科技有限公司 一种基于FPGA的低成本DSC信号产生装置及方法
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