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申请/专利权人：富士通株式会社
申请日：2014-05-23
公开（公告）日：2017-02-15
公开（公告）号：CN106416085A
专利技术分类：.不等或自适应防错，例如根据源信息的有效性提供不同级别的保护，或根据传输信道特性的变化自适应编码[2006.01]
专利摘要：本发明涉及运算电路、编码电路以及解码电路。使运算处理高速化。存储器M0～M15对成为进行异或运算的单位的数据块进行保持，选择电路2a～2p接受选择信号，并基于选择信号来选择从存储器M0～M15读出的多个数据块中的、使用于异或运算的2个以上的数据块，XOR电路3a～3o异或运算电路进行基于由选择电路2a～2p选择出的2个以上的数据块的异或运算。
专利权项：一种运算电路，其特征在于，具有：多个存储器，保持成为进行异或运算的单位的数据块；多个选择电路，接受选择信号，并基于所述选择信号来选择从所述多个存储器读出的多个所述数据块中的使用于异或运算的2个以上的数据块；以及1个或者多个异或运算电路，进行基于由所述多个选择电路选择出的所述2个以上的数据块的异或运算。
百度查询： 富士通株式会社 运算电路、编码电路以及解码电路
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