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龙图腾网恭喜湖南源科创新科技有限公司申请的专利一种面向嵌入式异构平台的高速数据交换方法及系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119739548B 。

龙图腾网通过国家知识产权局官网在2025-06-06发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510253250.4，技术领域涉及：G06F9/54；该发明授权一种面向嵌入式异构平台的高速数据交换方法及系统是由扈世伟;蒋湘涛;邹家贤;鲁奎麟设计研发完成，并于2025-03-05向国家知识产权局提交的专利申请。

本一种面向嵌入式异构平台的高速数据交换方法及系统在说明书摘要公布了：本发明涉及数据传输技术领域，公开了一种面向嵌入式异构平台的高速数据交换方法及系统，将DDR模块映射为CPU模块和DSP模块的共享内存；当CPU模块和DSP模块中的数据发出者向共享内存写入数据时，根据写入数据和写入地址生成向CPU模块和DSP模块中的数据响应者触发的中断信号；根据数据响应者对中断信号的响应信号，确定数据响应者对写入数据是否需要读取，从而管理CPU模块和DSP模块分别对写入地址的读写权限；将共享内存的写入状态向CPU模块和DSP模块分别进行同步。本发明有利于在嵌入式异构平台中，为DSP与CPU的数据交互过程提供简单高效的直接共享机制。

本发明授权一种面向嵌入式异构平台的高速数据交换方法及系统在权利要求书中公布了：1.一种面向嵌入式异构平台的高速数据交换方法，其特征在于，应用于嵌入式异构平台系统，所述嵌入式异构平台系统包括FPGA模块以及分别与FPGA模块通讯连接的CPU模块和DSP模块；FPGA模块连接有DDR模块；所述方法，包括如下步骤：在FPGA模块与CPU模块之间建立高速PCIe数据通道，在FPGA模块与DSP模块之间建立高速SRIO数据通道；将DDR模块构建为CPU模块和DSP模块的共享内存，并将共享内存向CPU模块和DSP模块分别进行内存映射；当CPU模块和DSP模块中的数据发出者向共享内存写入数据时，根据写入数据和写入地址生成向CPU模块和DSP模块中的数据响应者触发的中断信号；根据数据响应者对中断信号的响应信号，确定数据响应者对写入数据是否需要读取，从而管理CPU模块和DSP模块分别对写入地址的读写权限，包括：当数据响应者对中断信号的响应信号为需读取写入数据时，对待管控原子操作块进行锁定；在侦测到数据响应者从待管控原子操作块中成功读取写入数据后，对锁定的待管控原子操作块进行解锁；当数据响应者对中断信号的响应信号为不需读取写入数据时，对待管控原子操作块不进行锁定，其中，当CPU模块和DSP模块中的其中一个向对应的共享内存写入数据时，将写入数据分配的写入地址对应的原子操作块作为待管控原子操作块；根据CPU模块和DSP模块分别锁定的原子操作块数量，判断CPU模块和DSP模块分别对应的运行状态是忙碌或者空闲；将共享内存的写入状态向CPU模块和DSP模块分别进行同步。

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