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龙图腾网恭喜中科芯磁科技(珠海)有限责任公司申请的专利基于FPGA架构文件的芯片电路自动生成器及方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119720897B 。

龙图腾网通过国家知识产权局官网在2025-05-27发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510214193.9，技术领域涉及：G06F30/347；该发明授权基于FPGA架构文件的芯片电路自动生成器及方法是由韩小炜;吴利华;赵凯;崔冰设计研发完成，并于2025-02-26向国家知识产权局提交的专利申请。

本基于FPGA架构文件的芯片电路自动生成器及方法在说明书摘要公布了：本发明涉及芯片电路布局技术领域，基于FPGA架构文件的芯片电路自动生成器及方法，所述芯片电路自动生成器，包括输入模块、布局布线模块、验证模块及输出模块；所述输入模块，用于利用所述架构文件解析器，对用户输入的FPGA架构文件进行解析；所述布局布线模块，用于对所述需求列单元电路模型集合中的各个列单元电路模型进行排布连接，及对所述行单元电路集合中的各个行单元电路进行排布连接；所述验证模块，用于对所述行单元电路集合进行基于预设错误类型集合的验证操作，及对所述顶层电路图进行基于所述错误类型集合的验证操作；所述输出模块，用于将所述顶层电路图进行格式化输出。本发明可以提高芯片电路连接的效率及准确性。

本发明授权基于FPGA架构文件的芯片电路自动生成器及方法在权利要求书中公布了：1.一种基于FPGA架构文件的芯片电路自动生成器，其特征在于，所述芯片电路自动生成器，包括输入模块、布局布线模块、验证模块及输出模块；所述芯片电路自动生成器中，还包括FPGA顶层电路自动化生成程序；所述FPGA顶层电路自动化生成程序是基于Python与Cadenceskill开发得到的，所述FPGA顶层电路自动化生成程序包括读取架构服务及解析架构服务；所述FPGA顶层电路自动化生成程序，用于对所述输入模块及布局布线模块进行数据格式配置；其中，所述读取架构服务，用于利用所述Python中的openpyxl库，读取所述FPGA架构文件，得到电路设计信息；其中，所述解析架构服务，用于利用预构建的.map文本格式，对所述电路设计信息进行数据类型配置，得到.map文本格式的电路设计信息；其中，所述.map文本格式由结构化、索引、方向、关联邻近关系及实例信息的关键字组成；所述输入模块包括架构文件解析器及基础列单元电路库；其中，所述基础列单元电路库包括预设数值数量的列单元电路模型：所述列单元电路模型，由对预构建的列单元电路进行标准化存储得到；所述列单元电路模型，用于为所述输入模块提供检索信息，使得各个列单元电路被所述输入模块进行独立调用；其中，所述列单元电路由对预构建的逻辑单元电路进行列方向排列得到；其中，所述标准化存储的配置过程，包括根据预设的y坐标设置，利用所述Cadenceskill中dbAccess的dbCreateRect，将各个列单元电路的高度保持一致；利用所述Cadenceskill中的sort，对各个列单元电路中的IO端口，按ASCII码顺序进行排列；所述输入模块，用于利用所述架构文件解析器，对用户输入的FPGA架构文件进行解析，得到电路设计信息，并根据所述电路设计信息，查询所述基础列单元电路库，得到需求列单元电路模型集合；所述布局布线模块，用于根据所述电路设计信息，对所述需求列单元电路模型集合中的各个列单元电路模型进行排布连接，得到行单元电路集合；所述布局布线模块，还用于根据所述验证模块发送的行单元电路验证结果及所述电路设计信息，对所述行单元电路集合中的各个行单元电路进行排布连接，得到顶层电路图；所述验证模块，用于对所述行单元电路集合进行基于预设错误类型集合的验证操作，得到行单元电路验证结果；所述验证模块，还用于对所述顶层电路图进行基于所述错误类型集合的验证操作，得到顶层电路验证结果；所述输出模块，用于根据所述顶层电路验证结果，将所述顶层电路图进行格式化输出，得到目标形式FPGA电路。

如需购买、转让、实施、许可或投资类似专利技术，可联系本专利的申请人或专利权人中科芯磁科技(珠海)有限责任公司，其通讯地址为：519070 广东省珠海市香洲区前河北路68号之环宇城写字楼7层08单元；或者联系龙图腾网官方客服，联系龙图腾网可拨打电话0551-65771310或微信搜索“龙图腾网”。