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龙图腾网恭喜四川九洲空管科技有限责任公司申请的专利基于FPGA实现的低信噪比下ADS-B IN信号码元识别提取方法、介质及装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115622844B 。

龙图腾网通过国家知识产权局官网在2025-05-16发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211258443.1，技术领域涉及：H04L25/03；该发明授权基于FPGA实现的低信噪比下ADS-B IN信号码元识别提取方法、介质及装置是由王华军;邹亮;蒋鑫;杨滢弘设计研发完成，并于2022-10-14向国家知识产权局提交的专利申请。

本基于FPGA实现的低信噪比下ADS-B IN信号码元识别提取方法、介质及装置在说明书摘要公布了：本发明提供一种基于FPGA实现的低信噪比下ADS‑BIN信号码元识别提取方法、介质及装置，所述方法包括：对输入信号进行自相关运算；产生脉宽为N微秒的标准脉冲；对自相关运算后的信号与标准脉冲进行互相关运算后进行报头检测；确定报头后，根据脉冲时序找到第一个码元位置，利用移位寄存器对第一个码元前后N微秒进行存储；计算第一个码元前N微秒的幅度值；计算第一个码元后N微秒的幅度值；根据脉宽为2N微秒的使能信号进行采样，当使能信号有效时，将第一个码元前后N微秒的幅度值进行比较，根据比较结果输出码字；确定采样次数，完成数据锁定。本发明能够实现低信噪比下S模式1090ES码元提取。

本发明授权基于FPGA实现的低信噪比下ADS-B IN信号码元识别提取方法、介质及装置在权利要求书中公布了：1.一种基于FPGA实现的低信噪比下ADS-BIN信号码元识别提取方法，其特征在于，包括如下步骤：步骤1：对输入信号进行自相关运算；步骤2：产生脉宽为N微秒的标准脉冲；步骤3：对步骤1中自相关运算后的信号与步骤2产生的标准脉冲进行互相关运算；步骤4：对步骤3中互相关运算后的信号进行报头检测；步骤5：在步骤4确定报头后，根据脉冲时序找到第一个码元位置，利用移位寄存器对第一个码元前后N微秒进行存储；步骤6：计算第一个码元前N微秒的幅度值，记为sum_pre；计算第一个码元后N微秒的幅度值，记为sum_later；步骤7：根据脉宽为2N微秒的使能信号进行采样，当使能信号有效时，将sum_pre和sum_later进行比较，根据比较结果输出码字；步骤8：根据DF值，确定采样次数，完成数据锁定；步骤1中实现所述自相关运算的电路包括：延时电路、检波器和积分器；所述延时电路和检波器的输入端均用于输入信号；所述延时电路的输出端连接检波器；所述检波器的输出端连接积分器的输入端；所述积分器的输出端用于输出信号。

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