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龙图腾网恭喜天津航空机电有限公司申请的专利一种频率可配置的带通滤波电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN113992187B 。

龙图腾网通过国家知识产权局官网在2025-04-08发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202111336813.4，技术领域涉及：H03H11/04；该发明授权一种频率可配置的带通滤波电路是由韩越;王耀;郭佳煦;韦清瀚;郭保会设计研发完成，并于2021-11-12向国家知识产权局提交的专利申请。

本一种频率可配置的带通滤波电路在说明书摘要公布了：本发明是一种频率可配置的带通滤波电路，包括晶振模块，用于滤除高频信号的计数器芯片U4、U5，用于滤除低频信号的计数器芯片U1、U2、U3，计数器芯片U6，非门逻辑模块U9A、U10A，与门逻辑模块U7A,U8A，能够滤除计数器设定的高频截止频率以上的高频信号，同时能够通过另外的计数器模块将输入频率低于设定的低频截止频率的低频信号滤除，最终得到在相应范围内的频率信号。与现在的电路相比，本发明电路可配置性强，实用性高，能够对特定频率范围的频率信号进行滤波。

本发明授权一种频率可配置的带通滤波电路在权利要求书中公布了：1.一种频率可配置的带通滤波电路，包括晶振模块，用于滤除高频信号的计数器芯片U4、U5，用于滤除低频信号的计数器芯片U1、U2、U3，计数器芯片U6，非门逻辑模块U9A、U10A，与门逻辑模块U7A,U8A；晶振模块Y1输出时钟信号，用于给带通滤波电路提供稳定的时钟信号来源，时钟频率为F；晶振模块Y2输出时钟信号，用于给带通滤波电路提供稳定的时钟信号来源，时钟频率为f；计数器芯片为10进制计数器，用于根据输入的时钟信号，在满足计数条件时进行计数，通过计数输出引脚Qn，n为自然数，和进位输出引脚TC输出对应的计数信号，供后级电路进行处理；非门逻辑模块用于信号传输过程中的非逻辑处理；与门逻辑模块用于信号传输过程中的与逻辑处理；其特征在于，所述晶振模块包括晶振Y1，电容C1和电阻R1，晶振Y2,电容C2,电阻R2，晶振Y1的VCC供电端连接供电电源，并通过电容C1接地进行滤波处理，晶振Y1的时钟信号输出端CLK连接匹配电阻R1后，向后级电路输出时钟信号CLK-1；晶振Y2的VCC供电端连接供电电源，并通过电容C2接地进行滤波处理，晶振Y2的时钟信号输出端CLK连接匹配电阻R2后，向后级电路输出时钟信号CLK-2；晶振Y1输出的时钟信号CLK-1进入计数器芯片U1、U2、U3的CLK端，计数器芯片U1的使能端CET和使能端CEP均连接供电电源，使计数器芯片U1每次收到时钟信号CLK-1时均进行累加计数，计数器芯片U1的进位输出引脚TC与计数器芯片U2的使能端CET和使能端CEP连接，当计数器芯片U1累加计数达到额定计数值时，向计数器芯片U2输出高电平，使能计数器芯片U2，计数器芯片U2接收时钟信号CLK-1，并在每次收到时钟信号CLK-1时均进行累加计数，计数器芯片U2的进位输出引脚TC与计数器芯片U3的使能端CET和使能端CEP连接，当计数器芯片U2累加计数达到额定计数值时，向计数器芯片U3输出高电平，使能计数器芯片U3，计数器芯片U3接收时钟信号CLK-1，计数器芯片U3的进位输出引脚TC经过非门逻辑模块U10A，连接至与门逻辑模块U7A的一个输入端；待滤波的输入信号INPUT_SIGNAL输入计数器芯片U4的CLK端、复位端MR和计数器芯片U5的复位端MR，计数器芯片U4的使能端CET和使能端CEP均连接供电电源，计数器芯片U4的第一个计数输出引脚Q0连接与门逻辑模块U8A的一个输入端，与门逻辑模块U8A的输出端连接计数器芯片U5的使能端CEP，计数器芯片U5的使能端CET连接供电电源，计数器芯片U5的CLK端输入为晶振Y2输出的时钟信号CLK-2，计数器芯片U5的第一个计数输出引脚Q0同时连接非门逻辑模块U9A的输入端，和计数器芯片U6的CLK端和与门逻辑模块U7A的另一个输入端，计数器芯片U5的第一个计数输出引脚Q0输出信号SIGNAL，非门逻辑模块U9A的输出端连接与门逻辑模块U8A的另一个输入端；计数器芯片U6的复位端MR连接与门逻辑模块U7A的输出端，计数器芯片U6的使能端CET和使能端CEP均连接供电电源，计数器芯片U6的第一个计数输出端Q0输出最终经过滤波处理的OUTPUT_SIGNAL信号。

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