恭喜西安微电子技术研究所冯海强获国家专利权
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龙图腾网恭喜西安微电子技术研究所申请的专利一种对多种以太网接口模式的通用时钟管理系统和方法获国家发明授权专利权,本发明授权专利权由国家知识产权局授予,授权公告号为:CN115694774B 。
龙图腾网通过国家知识产权局官网在2025-04-08发布的发明授权授权公告中获悉:该发明授权的专利申请号/专利号为:202211337852.0,技术领域涉及:H04L7/027;该发明授权一种对多种以太网接口模式的通用时钟管理系统和方法是由冯海强;李小波;赵文琦;马徐瀚;张方;李龙飞;杨靓;王剑峰设计研发完成,并于2022-10-28向国家知识产权局提交的专利申请。
本一种对多种以太网接口模式的通用时钟管理系统和方法在说明书摘要公布了:本发明公开了一种对多种以太网接口模式的通用时钟管理系统和方法,包括PLL模块、Devider模块、MUX_1模块、MUX_2模块、MAC模块、MUX_3模块、MUX_4模块、MUX_6模块、MUX_7模块;通过对各种接口模式下时钟信号进行复用以及设置双向管脚,从而减少了信号数量;通过对接收和发送通路进行分离,使接口更加清晰;用户只需要根据自己的需求选择端口模式及工作频率,该结构会自动切换到与其适配的时钟频率;通用时钟管理方法有效解决了时钟结构复杂、接口信号多、用户不易使用的问题;同时通过对RGMII接口两种工作模式下时钟路径和数据路径的分离,保证了物理实现时序的收敛性。
本发明授权一种对多种以太网接口模式的通用时钟管理系统和方法在权利要求书中公布了:1.一种对多种以太网接口模式的通用时钟管理系统,其特征在于,包括PLL模块、Devider模块、MUX_1模块、MUX_2模块、MAC模块、MUX_3模块、MUX_4模块、MUX_6模块、MUX_7模块;所述PLL模块的输出端连接Devider模块的输入端,Devider模块的输出端连接MUX_1模块的输入端,MUX_1模块的输出端连接MUX_2模块的输入端;MUX_2模块的输入端连接双向PAD电路;所述MUX_2模块用于依据控制信号对GMIIMIIRGMIIRvMII四种接口模式进行切换;所述MUX_2模块的输出端连接MAC模块的输入端;MAC模块用于进行接口模式及速率选择后的采样;对于接收通路,MUX_2模块中RvMII接口模式选择MUX_1模块输出的时钟频率,GMIIMIIRGMII三种接口模式下选择外部输入的IMP_RXCLK,若是RGMII接口模式,选择nomal和delay切换后的时钟频率;MUX_3模块用于依据IMP接口接收delay模式控制信号进行对IMP_RXCLK和imp_rxclk_d的选择;所述IMP_RXCLK为外部输入的双向管脚;所述imp_rxclk_d为IMP_RXCLK经过delay模式的输出;所述MUX_7模块用于在RGMII接口模式下,进行接收数据和控制信号的选择;对于发送通路,MUX_2模块中GMIIRGMIIRvMII三种接口模式选择MUX_1模块输出的时钟频率,MII接口模式下选择外部输入的IMP_TXCLK,若是RGMII接口模式,选择nomal和delay切换后的时钟频率;所述MUX_4模块用于依据delay模式控制信号对时钟进行选择;所述MUX_6模块用于delay模式控制信号进行发送数据和控制信号的选择;所述PLL模块用于将输入的25MHz时钟进行10倍频,产生250MHz时钟传输给Devider模块;所述Devider模块用于对PLL模块输出的时钟进行分频,产生125MHz25MHz2.5MHz三种时钟;所述MUX_1模块用于依据控制信号对Devider模块分频后的125MHz25MHz2.5MHz三种时钟频率进行选择;所述MUX_6模块用于根据IMP接口发送delay模式控制信号IMP_TXC_DELAY进行对发送数据和控制信号的选择,产生TXD[3:0]和TX_CTRL;当控制信号IMP_TXC_DELAY为0时,选择MAC模块产生的mac_txd[3:0]和mac_tx_ctrl信号,当控制信号IMP_TXC_DELAY为1时,选择Delay模块产生的mac_txd_d[3:0]和mac_tx_ctrl_d信号;所述MUX_7模块用于根据IMP接口接收delay模式控制信号IMP_RXC_DELAY进行接收数据和控制信号的选择,产生mac_rxd[3:0]和mac_rx_ctrl信号给MAC模块;当控制信号IMP_RXC_DELAY为1时,选择Delay模块产生的rxd_d[3:0]和rx_ctrl_d信号,当控制信号IMP_RXC_DELAY为0时,选择外部输入的RXD[3:0]和RX_CTRL信号;所述MUX_4模块用于根据IMP接口发送delay模式控制信号IMP_TXC_DELAY对时钟进行选择,产生时钟IMP_GTX_CLK;当IMP_TXC_DELAY信号为1时,选择delay模块后的时钟,否则选择MUX_1模块产生的时钟。
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