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龙图腾网恭喜电子科技大学申请的专利一种低噪声毫米波小数分频综合器锁相环结构获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115001489B 。

龙图腾网通过国家知识产权局官网在2025-03-25发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210600105.5，技术领域涉及：H03L7/197；该发明授权一种低噪声毫米波小数分频综合器锁相环结构是由王政;耿新林;叶宗霖;肖尧;谢倩设计研发完成，并于2022-05-27向国家知识产权局提交的专利申请。

本一种低噪声毫米波小数分频综合器锁相环结构在说明书摘要公布了：本发明属于数模混合电路领域，具体提供一种低噪声毫米波小数分频综合器锁相环结构，用以克服在传统基于时间误差放大器TA的锁相环结构中因TA动态范围较小且具有较大的非线性而恶化锁相环带内的量化噪声并产生分数分频杂散的问题；本发明在传统结构的基础上还包括：粗数字时间转换器CDTC、细数字时间转换器FDTC与数字时间转换器预失真校准电路；通过在时间误差放大器前后分别插入粗数字时间转换器与细数字时间转换器缩小时间误差放大器输入相位差的方差，以提高时间误差放大器的线性度，同时抑制分数分频产生的量化噪声；通过采用阈值优值DTC自适应预失真，降低杂散同时保持DTC的量化噪声的二阶整形。

本发明授权一种低噪声毫米波小数分频综合器锁相环结构在权利要求书中公布了：1.一种低噪声毫米波小数分频综合器锁相环结构，包括：鉴频鉴相器PFD、时间误差放大器TA、电荷泵CP、环路滤波器LF、压控振荡器VCO、分频器、DSM模块，其特征在于，所述锁相环结构还包括：粗数字时间转换器CDTC、细数字时间转换器FDTC与数字时间转换器预失真校准电路，其中，所述粗数字时间转换器的输入端连接分频器的输出端、输出端连接鉴频鉴相器的分频输入端，所述细数字时间转换器FDTC连接于时间误差放大器与电荷泵之间；所述数字时间转换器预失真校准电路包括：第一DTC预失真校准模块、第二DTC预失真校准模块与Bang-Bang鉴相器BBPD，细数字时间转换器的输出信号连接至Bang-Bang鉴相器的输入端，Bang-Bang鉴相器提取的相位误差信息并连接至第一DTC预失真校准模块与第二DTC预失真校准模块，第一DTC预失真校准模块产生CDTC控制信号并连接至粗数字时间转换器的控制端，第二DTC预失真校准模块产生FDTC控制信号并连接至细数字时间转换器的控制端；DSM模块连接分频器与第一DTC预失真校准模块，且第一DTC预失真校准模块连接第二DTC预失真校准模块。

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