恭喜博越微电子(江苏)有限公司刘小威获国家专利权
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龙图腾网恭喜博越微电子(江苏)有限公司申请的专利一种多并口PHY共享PLL的时钟及控制方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119442997B 。
龙图腾网通过国家知识产权局官网在2025-03-25发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510027091.6，技术领域涉及：G06F30/3312；该发明授权一种多并口PHY共享PLL的时钟及控制方法是由刘小威;刘德启设计研发完成，并于2025-01-08向国家知识产权局提交的专利申请。
本一种多并口PHY共享PLL的时钟及控制方法在说明书摘要公布了：本发明的目的是提供一种多并口PHY共享PLL的时钟及控制方法，该方法包括：SOC锁相环、多个PHY和多个内存控制器；所述SOC锁相环与所述PHY和所述内存控制器连接，用于提供时钟信号。本发明采用一套多个并口PHY共享外部PLL的时钟方案，节省了芯片中PLL的数量，降低了芯片的面积和功耗，特别适用于面积较小，有超低功耗要求的芯片，不仅仅适用于单个并口PHY的系统，更适用于多并口PHY的系统，让并口PHY在SoC系统中的集成方式变得更加灵活多样化。
本发明授权一种多并口PHY共享PLL的时钟及控制方法在权利要求书中公布了：1.一种多并口PHY共享PLL的时钟，其特征在于，包括：SOC锁相环、多个PHY和多个内存控制器；所述SOC锁相环与所述PHY和所述内存控制器连接，用于提供时钟信号；所述PHY还包括：24分频的分频器；所述24分频的分频器与所述SOC锁相环和DFIPHY时钟路径连接，用于将输入给PHY的高速时钟进行分频，产生一个内部的低速时钟；所述PHY包括：DFI时钟路径和DFIPHY时钟路径；所述DFIPHY时钟路径的时钟信号由所述SOC锁相环直接提供；所述DFI时钟路径的时钟信号由所述SOC锁相环输出的信号经过分频电路后提供；所述DFI时钟路径包括由所述SOC锁相环至PHY内部的第一触发器和第四触发器的时钟信号输入端；所述DFIPHY时钟路径包括由所述SOC锁相环至PHY内部的第二触发器和第三触发器的时钟信号输入端。
如需购买、转让、实施、许可或投资类似专利技术，可联系本专利的申请人或专利权人博越微电子(江苏)有限公司，其通讯地址为：214000 江苏省无锡市新吴区太湖国际科技园软件园四期天鹅座C座709室；或者联系龙图腾网官方客服，联系龙图腾网可拨打电话0551-65771310或微信搜索“龙图腾网”。
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1、本报告根据公开、合法渠道获得相关数据和信息，力求客观、公正，但并不保证数据的最终完整性和准确性。
2、报告中的分析和结论仅反映本公司于发布本报告当日的职业理解，仅供参考使用，不能作为本公司承担任何法律责任的依据或者凭证。
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