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龙图腾网恭喜西安航空学院申请的专利一种串联芯片间的数据同步优化方法、系统、设备及终端获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116401203B 。

龙图腾网通过国家知识产权局官网在2025-03-11发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310403880.6，技术领域涉及：G06F15/78；该发明授权一种串联芯片间的数据同步优化方法、系统、设备及终端是由周清军;乐万德设计研发完成，并于2023-04-17向国家知识产权局提交的专利申请。

本一种串联芯片间的数据同步优化方法、系统、设备及终端在说明书摘要公布了：本发明属于芯片控制技术领域，公开了一种串联芯片间的数据同步优化方法、系统、设备及终端，使用串联芯片组的首颗芯片时钟进行计数并产生信息编码；将信息编码依次串行后传输给后级芯片，后级芯片接收到编码后使用自身的时钟对编码进行计数；通过计算CNT与CNT0之比，计算得到后级每颗芯片时钟与首颗芯片时钟的偏差值；后级芯片使用偏差值对芯片待同步的数据以及持续的时间段进行校正，实现后级芯片的数据以及时间段均与首颗芯片同步。将本发明的串联芯片间的数据同步优化方法应用于多核SoC芯片，测试结果表明，优化后的多核SoC芯片在时钟偏差15％以内，串联芯片组持续运行二十四小时，最大时间累积偏差从之前的7.2小时减小到17.28秒，优化效果明显。

本发明授权一种串联芯片间的数据同步优化方法、系统、设备及终端在权利要求书中公布了：1.一种串联芯片间的数据同步优化方法，其特征在于，串联芯片间的数据同步优化方法包括：利用串联芯片的首颗芯片时钟进行计数并产生信息编码；将信息编码串行后传输给后级芯片，后级芯片对编码进行计数；计算后级每颗芯片时钟与首颗芯片时钟的偏差值，利用偏差值进行串联芯片间的数据同步优化；串联芯片间的数据同步优化方法包括以下步骤：步骤一，使用串联芯片组的首颗芯片时钟进行计数，在计数器值不大于某个特定值CNT0时间段内产生信息编码；步骤二，将信息编码依次串行后传输给后级芯片，后级芯片接收到编码后使用自身的时钟对编码进行计数；步骤三，通过计算CNT与CNT0之比，计算得到后级每颗芯片时钟与首颗芯片时钟的偏差值；步骤四，后级芯片使用偏差值对芯片待同步的数据以及持续的时间段进行校正，从而实现后级芯片的数据以及时间段均与首颗芯片同步；步骤二中的计数值为CNT；具体包括：（1）首颗芯片以自己的时钟周期进行计数，在CNT0=0到10^4内产生一段全1的串行高电平信息编码，若首颗芯片的时钟是准确的10MHz，那么全1的串行高电平信息编码传输时长T0=1ms；（2）该高电平信息编码依次向后级芯片串行传输，后级芯片使用自己的时钟进行计数，计数值为CNT，不同后级芯片CNT值有可能不同。

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