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龙图腾网恭喜智绘微电子科技(南京)有限公司申请的专利多FPGA芯片间可靠传输的通信方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN117708037B 。

龙图腾网通过国家知识产权局官网在2025-02-18发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202311631643.1，技术领域涉及：G06F15/173；该发明授权多FPGA芯片间可靠传输的通信方法是由钱家祥;石小刚设计研发完成，并于2023-11-30向国家知识产权局提交的专利申请。

本多FPGA芯片间可靠传输的通信方法在说明书摘要公布了：本发明公开了一种多FPGA芯片间可靠传输的通信方法，所述方法包括如下步骤：S1.选择分割点，将目标设计分割放在多个FPGA芯片中，分割后的模块分别为第N‑1模块至第N模块，其中N大于等于2；S2.当第N‑1模块向第N模块传输数据时，在FN‑1芯片中，第N‑1模块将数据传输到一个FIFO缓冲区中，FIFO传输数据到FN‑1的TX发送模块，FN‑1的TX发送模块向位于FN芯片中的RX接收模块传输数据，FN芯片中的RX接收模块将数据传输第N模块。本发明能够实现多个FPGA芯片间的数据可靠传输通信。

本发明授权多FPGA芯片间可靠传输的通信方法在权利要求书中公布了：1.一种多FPGA芯片间可靠传输的通信方法，其特征在于，包括以下步骤：S1.选择分割点，将目标设计分割放在多个FPGA芯片中，分割后的模块分别为第N-1模块至第N模块，其中N大于等于2；S2.当第N-1模块向第N模块传输数据时，在FN-1芯片中，第N-1模块将数据传输到一个FIFO缓冲区中，FIFO传输数据到FN-1的TX发送模块，FN-1的TX发送模块向位于FN芯片中的RX接收模块传输数据，FN芯片中的RX接收模块将数据传输第N模块；当第N模块向第N-1模块传输数据时，在FN芯片中，第N模块将数据传输到一个FIFO缓冲区中，FIFO传输数据到FN的TX发送模块，FN的TX发送模块向位于FN-1芯片中的RX接收模块传输数据，FN-1芯片中的RX接收模块将数据传输到第N-1模块；其中，所述S1中，分割点选择原则如下：位于目标设计外围；待传输数据相近且同时有效；信号隶属于相同时钟域；待传输数据位宽适中；所述S2中发送和接收方之间采用业界通用握手通信协议，信号Link_rx_ready是通信装置接收方提供的ready信号，说明接收方可以接收收据；信号Link_tx_valid是通信装置发送方提供的valid信号，说明发送方的数据有效；信号Link_tx_data是通信装置发送方向接收方传输的数据；当assert_on_txvalid和Link_rx_ready同时为高时传输一个Link_tx_data数据；S2的接收方中，首先对收到的信号进行三级同步处理，信号link_tx_valid_asyn_r0是Link_rx_valid同步第一级r0的输出；信号link_tx_valid_asyn_r1是Link_rx_valid同步第二级r1的输出；信号link_tx_valid_asyn_r2是Link_rx_valid同步第三级r2的输出；其中判断拼接表示，将{link_tx_valid_asyn_r0,link_tx_valid_asyn_r1,link_tx_valid_asyn_r2}拼接，当其为3’b011时信号assert_on_txvalid有效，表示在接收方时钟域下的数据有效；当其为3’b110时信号dis_assert_on_txvalid表示在接收方时钟域下的数据无效；以assert_on_txvalid为起点，dis_assert_on_txvalid为终点可得信号rev_valid，在该信号有效时保存输入Link_tx_data即可得到rev_data，rev_valid即为数据对应的有效信号，至此完成一个Link_tx_data的接收；然后分解rev_data，根据其高位rev_data所表达的数据顺序信息，通过寄存后重组恢复得到原始数据touser_data，数据对应有效信号为touser_valid。

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