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全频带时钟占空比校准电路、校准方法和存储器 

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摘要:本发明提供一种全频带时钟占空比校准电路、校准方法和存储器。利用译码电路将存储器的模式寄存器设置电路中反应存储器全频带工作频率的设置编码转化为输出信号,通过输出信号调节占空比检测电路的电容值,使其满足检测需求,以此提高时钟占空比校准质量。本发明能够在全频带工作时针对当前时钟频率及时对时钟占空比进行校准,校准的准确度高且及速度快,确保存储器时钟质量;且利用存储器模式自带电路,结构简单,成本较低。

主权项:1.一种全频带时钟占空比校准电路,其特征在于,包括:信号调整电路,用于接收并调整存储器的第一时钟信号以生成第二时钟信号;占空比检测单元,连接所述信号调整电路,用于检测所述第二时钟信号的占空比和将检测结果反馈至所述信号调整电路,所述占空比检测单元包括具有可调电容器的占空比检测电路;模式寄存器,包括反应所述存储器全频带工作的时钟频率的设置编码;译码电路,连接所述占空比检测电路和所述模式寄存器,以根据所述设置编码调节所述占空比检测电路中可调电容器的电容值;其中,所述占空比检测单元还包括第一计数器、第二计数器和第三计数器,三个所述计数器和三个延时链一一对应连接;所述占空比检测电路包括:时钟信号接收端,连接所述信号调整电路,用于接收所述第二时钟信号;主电路,包括所述可调电容器,用于通过对所述可调电容器进行充电和放电,检测所述第二时钟信号的占空比;检测信号接收端,接收检测使能信号,以控制所述主电路电容元件的充电和放电;锁存电路,连接三个所述计数器,用于接收所述主电路中时钟信号的使能次数形成的加减指令,并输出脉冲信号给三个所述计数器,以将计数结果传递给对应的所述延时链。

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