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摘要：本发明公开了一种减小模数转换器采样偏斜的电路系统，包括：模数转换器；转换时钟信号，其由主机发送至模数转换器中，启动模数转换器的转换；N路相位时钟信号，其设置在模数转换器中，N路相位时钟信号的周期相同，均为tclk，相邻两路时钟信号的相位差为tclkN，其中，N＝2；时钟选择电路，其与转换时钟信号和N路相位时钟信号均连接，当模数转换器接收到转换时钟信号后，时钟选择电路从N路相位时钟信号中，选择上升沿距离转换时钟信号的上升沿最接近的一路时钟信号，作为模数转换器的采样沿，对输入信号进行采样。该系统能够减少异步时钟触发采样的模数转换器采样沿抖动，从而减少时钟抖动对模数转换器信噪比的恶化。

主权项：1.减小模数转换器采样偏斜的电路系统，其特征在于，包括：模数转换器；转换时钟信号，其由主机发送至所述模数转换器中，启动模数转换器的转换；N路相位时钟信号，其设置在所述模数转换器中，N路相位时钟信号的周期相同，均为tclk，相邻两路时钟信号的相位差为tclkN，其中，N＝2；时钟选择电路，其与所述转换时钟信号和所述N路相位时钟信号均连接，当所述模数转换器接收到所述转换时钟信号后，所述时钟选择电路从N路相位时钟信号中，选择上升沿距离所述转换时钟信号的上升沿最接近的一路时钟信号，作为模数转换器的采样沿，对输入信号进行采样；其中，所述时钟选择电路具体包括：N个第一级D触发器，所述转换时钟信号与每个第一级D触发器的数据引脚D和RN复位引脚均相连接，N路相位时钟信号按顺序依次和N个第一级D触发器一一对应连接；N个与门，N个第一级D触发器的输出端按顺序依次和N个与门一一对应连接，且与每个第一级D触发器相邻的另一个第一级D触发器的输出端做非处理后连接至该第一级D触发器对应的与门上；N个第二级D触发器，N个与门的输出端与N个所述第二级D触发器一一对应连接，其中，所述转换时钟信号与每个第二级D触发器的RN复位引脚均相连接，N个所述第二级D触发器的数据引脚D均接地；N个单向三态门，每个第二级D触发器的输出端均与一单向三态门的使能信号输入端相连接，其中，与所述单向三态门、所述第二级D触发器、所述与门、所述第一级D触发器相对应的相位时钟信号也连接至该单向三态门上；其中，使得三态门使能信号变为1电平的相位时钟信号作为输出时钟送到CLK_SEL引脚上。

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