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摘要:一种浮点数计算电路100以及浮点数计算方法,浮点数计算电路100包括的拆分电路102拆分第一浮点数的尾数部分与第二浮点数的尾数部分。指数处理电路104得到拆分后的各尾数部分的第二移位数。计算电路105根据拆分后的各尾数部分以及拆分后的各尾数部分的第二移位数计算第一浮点数与所述第二浮点数的尾数部分的乘积。该浮点数计算电路100可以把位数较大的浮点数拆分为位数较小的浮点数,从而采用较小位数的乘法器来计算该位数较大的浮点数,该浮点数计算电路100时序开销短,硬件设计代价低,合理的利用了乘法器的计算性能。
主权项:1.一种浮点数计算电路,其特征在于,所述浮点数计算电路包括:内存控制器、拆分电路、存储电路、指数处理电路以及计算电路;所述拆分电路的输入端与所述内存控制器的输出端电连接,所述拆分电路的输出端与所述存储电路的输入端电连接;所述指数处理电路的输入端与所述存储电路的第一输出端电连接,所述指数处理电路的输出端与所述计算电路的第一输入端电连接;所述计算电路的第二输入端与所述存储电路的第二输出端电连接;所述内存控制器用于获取第一浮点数以及第二浮点数;所述拆分电路用于拆分所述第一浮点数的尾数部分与所述第二浮点数的尾数部分以及得到拆分后的各尾数部分的第一移位数;所述存储电路用于存储拆分后的各尾数部分、拆分后的各尾数部分对应的指数部分以及所述拆分后的各尾数部分的第一移位数;所述指数处理电路用于将所述第一浮点数的指数部分以及所述第二浮点数的指数部分相加以得到第一运算结果,以及,将所述拆分后的各尾数部分的第一移位数与拆分后的各尾数部分对应的指数部分相加以得到多个第二运算结果,根据多个第二运算结果得到拆分后的各尾数部分的第二移位数;所述计算电路用于根据所述拆分后的各尾数部分以及所述拆分后的各尾数部分的第二移位数计算所述第一浮点数与所述第二浮点数的尾数部分的乘积。
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