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摘要：本发明公开了一种基于加载序列的硬件友好型推测加载电路的方法，包括节省面积的设计一、节省面积的设计二、优化时序的设计。本发明开辟了写后读数据结构RAW！、提出了加载序列Load‑Sets的概念。采用RAW！结合Load‑Sets的检索方式，以较小的电路面积实现推测加载SpeculativeLoad过程中对前序存储指令dependentstore的精确更新。RAW！以Store指令写入的内存地址st_addr为键Key、以speculativeload与dependentstore的程序计数器的差值为值Values，避免存放完整的store_pc而耗费大量面积；在优化时序的设计中，先在Load‑Sets中匹配st_addr，锁定历史上针对该内存地址进行推测加载失败的Load指令，再在RAW！中索引这些Load指令，得到各个dependentstores。相比直接在RAW！中检索store_pc的传统做法，这种分步检索的方令检索复杂度从ON2降维到ON。

主权项：1.一种基于加载序列的硬件友好型推测加载电路的方法，其特征在于，包括节省面积的设计一、节省面积的设计二和优化时序的设计；所述节省面积的设计一，具体包括以下步骤：S1、提出了Load-Sets的数据结构，此时的键Key是store指令有待写入的内存地址st_addr；值Values是violatingload与各个dependentstore的PC的差值的集合；所述节省面积的设计二，具体包括以下步骤：P1、采用推测加载失败的指令的PCvio_ld_pc与其前序存储指令的PCstore_pc二者的差值取代store_pc进行存储，如公式1所示；即：{delta_pc|delta_pci＝vio_ld_pc-store_pci,i＝1,2,…}公式1；P2、在指令派发阶段DispatchStage，将新进的store_pc以及delta_pc作为解码电路的输入，得到公式2中的vio_ld_pc；即：vio_ld_pc＝delta_pci+store_pci,i＝1,2,…公式2；P3、通过获取的vio_ld_pc再去匹配RAW！中的Key；所述优化时序的设计，具体包括以下步骤：L1、当store指令位于DispatchStage时，检索该store是否是RAW！表项内容的一部分。若是，需要将该store更新为“最近一次”与violatingload产生RAW冲突的store；L2、采用Load-Sets结合RAW！的方式进行检索，对检索复杂度进行降维，采用先根据store写入的内存地址锁定所有相关的violatingload，再由vio_ld_pc检索得到各个dependentstores的检索方式将检索的复杂度从ON2降维到ON，从而确保时序收敛TimingClosure。

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