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摘要：本申请公开了处理模块、指令处理方法及芯片系统，属于集成电路设计技术领域。方法包括：在参考指令的取指阶段，预测参考指令的指令类型；在预测的参考指令的指令类型为RET指令的情况下，预测参考指令的第一返回地址，根据第一返回地址排队取指；获取在参考指令的预解码阶段预测得到的第二返回地址，根据第二返回地址验证第一返回地址，得到验证结果，验证结果用于控制是否继续根据第一返回地址排队取指。在取指阶段预测第一返回地址，基于第一返回地址提前进行排队取指，提前了第一返回地址对应的指令的取指时刻，使得取指连续，提高了处理模块的处理效率。
主权项：1.一种处理模块，其特征在于，所述处理模块包括：指令预测单元，用于在参考指令的取指阶段，预测所述参考指令的指令类型；在预测结果指示所述参考指令的指令类型为返回RET指令的情况下，预测所述参考指令的第一返回地址，向地址控制单元和验证单元发送所述第一返回地址，所述RET指令用于在被调程序结束调用时返回；所述地址控制单元，用于接收所述第一返回地址，根据所述第一返回地址排队取指；所述验证单元，用于接收所述第一返回地址，获取在所述参考指令的预解码阶段预测得到的第二返回地址，根据所述第二返回地址验证所述第一返回地址，得到验证结果，所述验证结果用于控制所述地址控制单元是否继续根据所述第一返回地址排队取指。
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百度查询： 西安奕斯伟计算技术有限公司 北京奕斯伟计算技术股份有限公司 处理模块、指令处理方法及芯片系统
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