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申请/专利权人：上海海栎创科技股份有限公司

摘要：本发明提供一种低延时、驱动力可控的输入输出电路与方法，包括：第一MOS管驱动电路、第二MOS管驱动电路和输入电路，利用输入至第一控制电路的第二驱动信号和输入至第一MOS管驱动支路中的第一控制信号共同控制第一MOS管驱动电路中第一MOS管驱动支路的开启或关闭，并同时控制第二控制电路中接入的第一驱动信号的高低；类似的，利用第一驱动信号和第二控制信号共同控制第二MOS管驱动电路中第二MOS管驱动支路的开启或关闭，以及接入第一控制电路中第二驱动信号的高低，使得第一MOS管驱动电路和第二MOS管驱动电路不会同时开启，防止输出短路电流，并降低了预驱动延时，实现了驱动力可控，减小了电路面积。

主权项：1.一种低延时、驱动力可控的输入输出电路，其特征在于，包括：第一MOS管驱动电路和第二MOS管驱动电路；所述第一MOS管驱动电路包括第一控制电路和第一MOS管驱动支路；其中，所述第一控制电路包括:第一与门、第一与非门、第一非门和第二非门；所述第一与门的输入端接第二驱动信号，输出端与所述第一与非门的第一输入端相连，所述第一与非门的第二输入端接数字输出信号，所述第一与非门的输出端与所述第一非门的输入端连接，所述第一非门的输出端与所述第二非门的输入端连接，所述第二非门的输出端与所述第一MOS管驱动支路相连；所述第一MOS管驱动支路包括：第一或非门、第三非门、PMOS管和电阻；所述第一或非门的第一输入端与所述第一控制电路的输出端相连，第二输入端接所述第一控制信号，所述第一或非门的输出端与所述第三非门的输入端相连；所述第三非门的输出端与所述PMOS管的栅极相连，所述PMOS管的源极接电源电压，所述PMOS管的漏极通过一电阻与所述第二MOS管驱动支路相连；所述第二MOS管驱动电路包括第二控制电路和第二MOS管驱动支路；其中，所述第二控制电路包括：第二与门、第四非门、第五非门和第二与非门；所述第二与门的输入端接第一驱动信号；所述第四非门的输入端接数字输出信号，输出端与所述第二与非门的第一输入端相连，所述第二与非门的第二输入端与所述第二与门的输出端相连，所述第二与非门的输出端与所述第五非门的输入端相连，所述第五非门的输出端与所述第二MOS管驱动支路相连；所述第二MOS管驱动支路包括第三与非门、第六非门、NMOS管和电阻；所述第三与非门的第一输入端与所述第二控制电路的输出端相连，第二输入端接所述第二控制信号，所述第三与非门的输出端与所述第六非门的输入端相连，所述第六非门的输出端与所述NMOS管的栅极相连，所述NMOS管的源极接地，所述NMOS管的漏极通过一电阻与所述第一MOS管驱动支路相连；所述第一控制电路的输入端接第二驱动信号，所述第一MOS管驱动支路的输入端接第一控制信号，所述第二驱动信号与所述第一控制信号共同控制所述第一MOS管驱动支路的开启或关闭以及第一驱动信号的电平高低；所述第二控制电路的输入端接所述第一驱动信号，所述第二MOS管驱动支路的输入端接第二控制信号，所述第一驱动信号与所述第二控制信号共同控制所述第二MOS管驱动支路的开启或关闭以及第二驱动信号的电平高低；当所述第一MOS管驱动支路处于开启状态时，所述第二MOS管驱动支路处于关闭状态；当所述第一MOS管驱动支路处于关闭状态时，所述第二MOS管驱动支路处于开启状态。

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