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申请/专利权人：桂林电子科技大学
摘要：本发明提供的是一种FPGA间的高速串行通信方法，其特征是：它由TX_DATA模块101、TX_CLOCK_GEN模块102、TX_RESET_CTRL模块103、TX_Aurora_8B10B模块104、TX_SFP+模块105、RX_SFP+模块106、RX_Aurora_8B10B模块107、RX_DATA模块108、RX_CLOCK_GEN模块109和RX_RESET_CTRL模块110组成。本发明可用于FPGA间的高速串行通信，可广泛用于高速数据通信领域。
主权项：1.一种FPGA间的高速串行通信方法，其特征是：它由TX_DATA模块101、TX_CLOCK_GEN模块102、TX_RESET_CTRL模块103、TX_Aurora_8B10B模块104、TX_SFP+模块105、RX_SFP+模块106、RX_Aurora_8B10B模块107、RX_DATA模块108、RX_CLOCK_GEN模块109和RX_RESET_CTRL模块110组成。所属系统分为发送端和接收端，TX_CLOCK_GEN模块102和RX_CLOCK_GEN模块109分别为发送端和接收端提供时钟信号。发送端中需要发送的数据在TX_DATA模块101中完成数据打包，打包好的数据发送到TX_Aurora_8B10B模块104中，所发送的数据在TX_Aurora_8B10B模块104中完成并串转换、数据封帧并转换为差分信号TX_P和TX_N。信号TX_P和TX_N经过TX_SFP+模块105从电信号转换为光信号，转换后的光信号经过RX_SFP+模块106从光信号转换为电信号，转换后的信号由RX_Aurora_8B10B模块107接收完成串并转换数据解包，解包后的数据传输到RX_DATA模块108中进行数据处理，完成数据接收。
全文数据：
权利要求：
百度查询： 桂林电子科技大学 一种FPGA间的高速串行通信方法
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