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申请/专利权人：弗莱克斯-罗技克斯技术公司
摘要：一种集成电路设备包括广播数据路径、加权值存储器和乘法‑累加MAC单元。MAC单元共同耦合到广播数据路径中的每条广播数据路径并被耦合成经由相应加权值路径从加权值存储器接收相应加权值。MAC单元中的每个MAC单元包括分别耦合到广播数据路径的多个MAC电路，MAC单元中的给定MAC单元内的MAC电路中的每个MAC电路i经由广播数据路径中的相应广播数据路径接收输入数据值，并经由相应加权值路径中的共享加权值路径接收加权值中的共享加权值，ii通过将输入数据值与加权值中的共享加权值相乘来生成一系列乘法乘积，以及iii累加乘法乘积之和。
主权项：1.一种集成电路设备，包括：多条广播数据路径；加权值存储器；以及多个乘法-累加MAC单元，共同耦合到所述广播数据路径中的每条广播数据路径并被耦合成经由相应加权值路径从所述加权值存储器接收相应加权值，MAC单元中的每个MAC单元具有分别耦合到所述广播数据路径的多个MAC电路，MAC单元中的给定MAC单元内的MAC电路中的每个MAC电路具有：数据输入，被耦合成在多个时序周期中的每个时序周期期间经由所述广播数据路径中的相应广播数据路径接收输入数据值；加权值输入，被耦合成在所述多个时序周期中的每个时序周期期间经由所述相应加权值路径中的共享加权值路径接收加权值中的共享加权值；乘法器电路，通过将在所述多个时序周期中的每个时序周期期间接收到的输入数据值与在所述多个时序周期中的每个时序周期期间接收到的加权值中的共享加权值相乘来生成一系列乘法乘积；以及累加器电路，累加所述一系列乘法乘积内的构成乘法乘积之和。
全文数据：
权利要求：
百度查询： 弗莱克斯-罗技克斯技术公司 广播数据、共享权重乘法-累加
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