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申请/专利权人：合肥智芯半导体有限公司;苏州萨沙迈半导体有限公司;上海萨沙迈半导体有限公司;天津智芯半导体科技有限公司

摘要：本发明公开了一种涉及集成电路技术领域的FIFO存储器读写处理电路和芯片，所述FIFO存储器读写处理电路包括：写操作控制模块、读操作控制模块、可配置模块、空满状态判断模块和双端口存取的FIFO存储器，其中，写操作控制模块用于控制通信模块的写接口的工作，读操作控制模块用于控制通信模块的读接口的工作，可配置模块用于配置时钟同步和分配每个通信模块在FIFO存储器中的地址范围，空满状态判断模块用于判断通信模块的存储空间的空满状态，双端口存取的FIFO存储器支持不同通信模块的读写操作。采用该FIFO存储器读写处理电路能够动态配置通信模块所使用的FIFO存储器的大小，提高FIFO存储器的存储资源利用率，并且还能支持不同时钟域的通信模块的读写操作。

主权项：1.一种FIFO存储器读写处理电路，其特征在于，所述FIFO存储器读写处理电路包括：写操作控制模块、读操作控制模块、可配置模块、空满状态判断模块和双端口存取的FIFO存储器；所述写操作控制模块和所述读操作控制模块分别与所述可配置模块、所述空满状态判断模块和所述FIFO存储器连接；所述可配置模块包括同步定义单元和重分配单元；所述同步定义单元用于管理不同时钟域中的通信模块的写接口和读接口的时钟同步；所述重分配单元用于存储为每个所述通信模块分配的位于所述FIFO存储器中的地址范围；所述写操作控制模块接入所述通信模块的写接口，由相互连接的写接口同步逻辑单元和写操作判断选通单元构成；所述写接口同步逻辑单元用于根据所述同步定义单元确定的时钟同步，执行所述写接口的写操作同步；所述写操作判断选通单元用于确定所述写接口的写权限并选通具有写权限的写接口对应的写接口通路；所述读操作控制模块接入所述通信模块的读接口，由相互连接的读接口同步逻辑单元和读操作判断选通单元构成；所述读接口同步逻辑单元用于根据所述同步定义单元确定的时钟同步，执行所述读接口的读操作同步；所述写操作判断选通单元用于确定所述读接口的读权限并选通具有读权限的读接口对应的读接口通路；所述空满状态判断模块与所述可配置模块连接，用于根据所述通信模块的地址范围和具有写权限的所述通信模块的写指针和读指针，输出满标识，并根据所述通信模块地址范围和具有读权限的所述通信模块的读指针和写指针，输出空标识；所述FIFO存储器为多个通信模块共用的存储空间，用于在具有写权限的所述通信模块所分配的地址范围中存储具有写权限的写接口写入的数据，和用于在具有读权限的所述通信模块所分配的地址范围中读出具有读权限的读接口读取的数据。

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