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基于分段的DTC校正方法和ADPLL 

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申请/专利权人:成都电科星拓科技有限公司

摘要:本发明公开了一种基于分段的DTC校正方法和ADPLL。为校正DTC的非线性,本发明将DTC中的延迟单元划分为M个分段,每个分段中有N个延迟单元,对于第i分段的延迟单元,设置第i校正电路,第i校正电路接收DTC码值、待延迟相位和相位误差信号,并获得第i分段参数;通过DTC校准电路接收待延迟相位和第j分段参数,获得DTC码值;在DTC中应用所述DTC码值,其中M、N、i和j均是正整数。本发明可以在后台高精度地校正DTC步长值,且能适应环境变化。

主权项:1.一种基于分段的DTC校正方法,应用于ADPLL之中,所述DTC包括M×N个延迟单元,其特征在于:将DTC中的延迟单元划分为M个分段,每个分段中有N个延迟单元;其中,M和N均为正整数,N是分段值,分段号i是不超过M的任一正整数;对于第i分段的延迟单元,设置第i校正电路,第i校正电路接收DTC码值、待延迟相位和相位误差信号,并获得第i分段参数:第i分段DTC的步长值斜率k1[i]、第i分段的平均步长值k2[i]和第1分段至第i-1分段中延迟单元的总延迟相对于ADPLL输出时钟的相位k3[i];其中,k3[1]等于0,相位误差信号是ADPLL中鉴相器输出的表示相位误差的信号;通过DTC校准电路接收待延迟相位和第j分段参数,获得DTC码值;其中,j是被选中的分段号,是不超过M的一个正整数;以及,在DTC中应用所述DTC码值;其中,在所述第i校正电路中的第一子电路中,通过如下步骤获得k1[i]:将k3[i]乘以-1并与待延迟相位相加,获得第一结果;在取余模块中,DTC码值对分段值取余后,和第一结果相乘,获得第二结果;第二结果和相位误差信号相乘后,再与第一增益系数相乘,获得第三结果;第三结果和k1[i]的先前值相加,获得k1[i]。

全文数据:

权利要求:

百度查询: 成都电科星拓科技有限公司 基于分段的DTC校正方法和ADPLL

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