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申请/专利权人：意法半导体国际公司
摘要：本公开涉及具有浮点CORDIC指令的微处理器。一种用于迭代地计算角度的正弦和余弦的电路，包括：计数器；角度更新电路，其被配置为针对每次迭代计算所述角度的更新值；以及坐标更新电路，包括：第一寄存器，用于存储余弦值；第二寄存器，用于存储正弦值；以及具有相同结构的第一定制浮点加法器减法器CFPAS电路和第二CFPAS电路，其中所述第一寄存器的输出和所述第二寄存器的输出耦合到所述第一CFPAS电路的第一输入端子和第二输入端子，并且耦合到所述第二CFPAS电路的第二输入端子和第一输入端子，其中所述计数器的输出耦合到所述第一CFPAS电路的第三输入端子和所述第二CFPAS电路的第三输入端子。
主权项：1.一种用于通过多次迭代来迭代地计算浮点正弦函数和浮点余弦函数的电路，所述电路包括：计数器，被配置为在每次迭代之后递增1；角度更新电路，被配置为利用针对角度的初始值而被初始化，并且被配置为针对每次迭代基于所述角度的当前值和针对每次迭代的预定旋转角度来计算所述角度的更新值；以及坐标更新电路，包括：第一寄存器，用于存储对应于所述余弦函数的值；第二寄存器，用于存储对应于所述正弦函数的值；以及第一定制浮点加法器减法器电路和第二定制浮点加法器减法器电路，其中所述第一定制浮点加法器减法器电路和所述第二定制浮点加法器减法器电路具有相同结构，其中所述第一定制浮点加法器减法器电路和所述第二定制浮点加法器减法器电路中的每一者具有第一输入端子、第二输入端子、第三输入端子和第四输入端子，其中所述第一定制浮点加法器减法器电路的所述第一输入端子、所述第二输入端子和所述第三输入端子分别耦合到所述第一寄存器的输出端子、所述第二寄存器的输出端子和所述计数器的输出端子，并且其中所述第二定制浮点加法器减法器电路的所述第一输入端子、所述第二输入端子和所述第三输入端子分别被耦合到所述第二寄存器的输出端子、所述第一寄存器的输出端子和所述计数器的所输出端子。
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百度查询： 意法半导体国际公司 具有浮点CORDIC指令的微处理器
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