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申请/专利权人：合肥京东方卓印科技有限公司;京东方科技集团股份有限公司

摘要：本公开的实施例提供了一种移位寄存器单元及其驱动方法、一种栅极驱动电路和一种显示设备。所述移位寄存器单元包括：第一移位寄存器，被配置为在所述第一移位寄存器的上拉节点、第一下拉节点和第二下拉节点的电位的控制下，基于第一时钟信号端的信号产生第一控制输出信号和第二控制输出信号；以及第二移位寄存器，被配置为在所述第二移位寄存器的上拉节点、第一下拉节点和第二下拉节点的电位的控制下，基于第三时钟信号端的信号产生第二输出信号；其中所述第一移位寄存器的第一下拉节点连接至所述第二移位寄存器的第二下拉节点，所述第一移位寄存器的第二下拉节点连接至所述第二移位寄存器的第一下拉节点。

主权项：1.一种栅极驱动电路，包括N级级联的移位寄存器单元，其中，所述移位寄存器单元包括：第一移位寄存器，具有上拉节点、第一下拉节点和第二下拉节点，所述第一移位寄存器被配置为将第一输入信号端的信号输入至所述第一移位寄存器的上拉节点，以及在所述第一移位寄存器的上拉节点、第一下拉节点和第二下拉节点的电位的控制下，基于第一时钟信号端的信号产生第一控制输出信号和第二控制输出信号并分别提供至第一控制输出信号端和第二控制输出信号端，并且基于第二时钟信号端的信号产生第一输出信号并提供至第一输出信号端；以及第二移位寄存器，具有上拉节点、第一下拉节点和第二下拉节点，所述第二移位寄存器被配置为将第二输入信号端的信号传输至所述第二移位寄存器的上拉节点，以及在所述第二移位寄存器的上拉节点、第一下拉节点和第二下拉节点的电位的控制下，基于第三时钟信号端的信号产生第二输出信号并提供至第二输出信号端；其中所述第一移位寄存器的第一下拉节点连接至所述第二移位寄存器的第二下拉节点，所述第一移位寄存器的第二下拉节点连接至所述第二移位寄存器的第一下拉节点，其中，所述第一移位寄存器包括：第一输入电路，连接至所述第一输入信号端和所述第一移位寄存器的上拉节点，所述第一输入电路被配置为将所述第一输入信号端的信号输入至所述第一移位寄存器的上拉节点；第一控制电路，连接至所述第一移位寄存器的上拉节点和所述第一移位寄存器的第一下拉节点，所述第一控制电路被配置为在所述第一移位寄存器的上拉节点的电位的控制下控制所述第一移位寄存器的第一下拉节点的电位，第一控制输出电路，连接至所述第一移位寄存器的上拉节点、所述第一时钟信号端和所述第一控制输出信号端，所述第一控制输出电路被配置为在所述第一移位寄存器的上拉节点的电位的控制下，基于所述第一时钟信号端的信号产生第一控制输出信号并提供至所述第一控制输出信号端；第二控制输出电路，连接至所述第一移位寄存器的上拉节点、所述第一时钟信号端和所述第二控制输出信号端，所述第二控制输出电路被配置为在所述第一移位寄存器的上拉节点的电位的控制下，基于所述第一时钟信号端的信号产生第二控制输出信号并提供至所述第二控制输出信号端；第一输出电路，连接至所述第一移位寄存器的上拉节点、所述第二时钟信号端和所述第一输出信号端，所述第一输出电路被配置为在所述第一移位寄存器的上拉节点的电位的控制下，基于所述第二时钟信号端的信号产生第一输出信号并提供至所述第一输出信号端；以及第一下拉电路，连接至所述第一移位寄存器的第一下拉节点和第二下拉节点以及所述第一控制输出信号端、所述第二控制输出信号端和所述第一输出信号端，所述第一下拉电路被配置为在所述第一移位寄存器的第一下拉节点和第二下拉节点的控制下下拉所述第一控制输出信号端、所述第二控制输出信号端和所述第一输出信号端的电位，其中，所述第二移位寄存器包括：第二输入电路，连接至所述第二输入信号端和所述第二移位寄存器的上拉节点，所述第二输入电路被配置为将所述第二输入信号端的信号输入至所述第二移位寄存器的上拉节点；第二控制电路，连接至所述第二移位寄存器的上拉节点和所述第二移位寄存器的第一下拉节点，所述第二控制电路被配置为在所述第二移位寄存器的上拉节点的电位的控制下控制所述第二移位寄存器的第一下拉节点的电位；第二输出电路，连接至所述第二移位寄存器的上拉节点、所述第三时钟信号端和所述第二输出信号端，所述第二输出电路被配置为在所述第二移位寄存器的上拉节点的电位的控制下，基于所述第三时钟信号端的信号产生第二输出信号并提供至所述第二输出信号端；以及第二下拉电路，连接至所述第二移位寄存器的第一下拉节点和第二下拉节点以及所述第二输出信号端，所述第二下拉电路被配置为在所述第二移位寄存器的第一下拉节点和第二下拉节点的控制下下拉所述第二输出信号端的电位，其中，第n级移位寄存器单元的第一输入信号端连接至第n-2级移位寄存器单元的第一控制输出信号端，所述第n级移位寄存器单元的第二输入信号端连接至第n-2级移位寄存器单元的第二控制输出信号端，其中n和N为大于1的整数，2＜n＜N-4；并且第n级移位寄存器单元的第一复位信号端和第二复位信号端连接至第n+4级移位寄存器单元的第一控制输出信号端或第二控制输出信号端，以及其中，各级移位寄存器单元的第一时钟信号端连接为接收相应的时钟信号，使得该级移位寄存器单元基于所述相应的时钟信号产生所述第一控制输出信号和所述第二控制输出信号。

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