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申请/专利权人：中北大学

摘要：本发明属于本振信号发生技术领域，具体涉及一种取样器的低抖动超窄脉宽本振信号发生装置及方法，包括低抖动时钟产生模块、高速低抖动分频器模块、FPGA模块、时基放大模块，所述低抖动时钟产生模块的输出端连接有高速低抖动分频器模块的输入端，所述FPGA模块的控制通信模块分别与低抖动时钟产生模块、高速低抖动分频器模块的通信接口连接，所述高速低抖动分频器模块与时基放大模块连接。本发明利用低抖动时钟发生电路得到低抖动时钟信号，通过功分放大电路得到超窄脉冲信号，驱动50GHz取样器工作，本发明中时基信号抖动性能优异，确保了高速数据总线和集成电路的高可靠性，保证了时基信号的质量。本发明用于本振信号的发生。

主权项：1.一种取样器的低抖动超窄脉宽本振信号发生装置，其特征在于：包括低抖动时钟产生模块（U1）、高速低抖动分频器模块（U2）、FPGA模块（U3）、时基放大模块（U4），所述低抖动时钟产生模块（U1）的输出端连接有高速低抖动分频器模块（U2）的输入端，所述FPGA模块（U3）的控制通信模块分别与低抖动时钟产生模块（U1）、高速低抖动分频器模块（U2）的通信接口连接，所述高速低抖动分频器模块（U2）与时基放大模块（U4）连接；所述低抖动时钟产生模块（U1）包括程控参考源模块（1）、时钟发生模块（2），所述程控参考源模块（1）与时钟发生模块（2）连接；所述低抖动时钟产生模块（U1）的芯片采用HMC1035，所述低抖动时钟产生模块（U1）产生的时钟信号频率范围为25MHz-2500MHz，所述抖动时钟产生模块（U1）产生的时钟信号抖动指标小于97fsRMS；所述高速低抖动分频器模块（U2）采用高速低抖动芯片HMC988级联，所述高速低抖动分频器模块（U2）的抖动指标小于70fsRMS，所述高速低抖动分频器模块（U2）的分频范围为1~1024；所述时基放大模块（U4）包括放大模块的输入端（IN）、第一三极管（T1）、第二三极管（T2）、第三三极管（T3）、第一电容（C1）、第二电容（C2）、电感（L1），所述放大模块的输入端（IN）连接在第一三极管（T1）的基极上，所述第一三极管（T1）的集电极接地，所述第一三极管（T1）的发射极连接在第二三极管（T2）的基极上，所述第二三极管（T2）的集电极接地，所述第二三极管（T2）的发射极通过第一电容（C1）连接在第三三极管（T3）的基极上，所述第三三极管（T3）的发射极接地，所述第三三极管（T3）的集电极通过第二电容（C2）连接在电感（L1）上，所述第二电容（C2）与电感（L1）之间设有超窄脉宽的输出端。

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