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申请/专利权人:珠海电科星拓科技有限公司
摘要:本发明提供了一种基于SV语言的网表仿真系统与方法,涉及芯片验证技术领域。该基于SV语言的网表仿真系统包括验证用例模块、验证平台、基于SystemVerilog语言设计的SV物理层模块、PIPE接口激励模块和待测网表。其中,验证平台内置验证环境,验证环境与SV物理层模块连接,SV物理层模块通过PIPE接口激励模块与待测网表连接。本发明通过将SV物理层模块和PIPE接口激励模块一起替换物理层模型,能够节省大量仿真时间。通过SV物理层模块和PIPE接口激励模块对接收到的多条数据进行注错和随机化操作,即将多条数据之间引入随机偏斜差,进行异常验证,提高了芯片后仿真的随机性和覆盖率。
主权项:1.一种基于SV语言的网表仿真系统,其特征在于,包括:验证用例模块、验证平台、基于SystemVerilog语言设计的SV物理层模块、PIPE接口激励模块和待测网表;所述验证平台内置验证环境,所述验证环境与所述SV物理层模块连接,所述SV物理层模块通过所述PIPE接口激励模块与所述待测网表连接;其中,所述待测网表用于提供待测芯片中带时序的真实物理电路信息;所述验证用例模块用于配置符合PCIE协议的多种激励信号;所述验证环境用于将多种激励信号发送至所述SV物理层模块;所述SV物理层模块和所述PIPE接口激励模块用于对多种激励信号进行注错和随机化操作,以生成随机激励信号;所述待测网表还用于依据所述随机激励信号生成处理信号,并将所述处理信号发送至所述PIPE接口激励模块;所述PIPE接口激励模块和所述SV物理层模块还用于对所述处理信号进行注错和随机化操作,以生成随机处理信号;所述验证环境还用于对接收到的所述随机处理信号进行解析,以判断所述待测网表是否符合预期。
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权利要求:
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