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申请/专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国家电网有限公司

摘要：本发明公开了一种面向对象的芯片级端口互连电路及其端口互连方法，其中，面向对象的芯片级端口互连电路包括：PAD模块，PAD模块用于实现芯片与外部电路的连接；CORE模块，CORE模块包括PINMUX单元、IOCTRL控制单元、CPU单元和多个IP核，其中，PINMUX单元分别与PAD模块和多个IP核连接，CPU单元用于对IOCTRL控制单元进行配置，以使IOCTRL控制单元通过PINMUX单元对PAD模块与各IP核的连接通路进行控制。该芯片级端口互连电路可快速、高质量地完成芯片研发过程中各类IP核端口之间的互连需求。

主权项：1.一种面向对象的芯片级端口互连电路，其特征在于，包括：芯片顶层PAD模块，所述PAD模块用于实现芯片与外部电路的连接；CORE模块，所述CORE模块包括PINMUX单元、IOCTRL控制单元、CPU单元和多个IP核，所述PINMUX单元分别与所述PAD模块和所述多个IP核连接，所述CPU单元用于对所述IOCTRL控制单元进行配置，以使所述IOCTRL控制单元通过所述PINMUX单元对所述PAD模块与各IP核的连接通路进行控制；所述PINMUX单元分别与所述PAD模块之间的连接为固定连接；所述PAD模块包括第一端口和第二端口，所述第一端口用以连接外部电路；所述CORE模块还包括第三端口，所述第三端口与所述第二端口固定连接；所述PINMUX单元包括第四端口和第五端口，所述第四端口与所述第三端口固定连接，所述第五端口与所述多个IP核之间的连接为可控连接；所述第二端口、所述第三端口、所述第四端口均包括多个引脚，所述多个引脚包括输入引脚和输出引脚，所述输入引脚接0，所述输出引脚浮空；所述第五端口与所述多个IP核之间的连接通路的个数为2n，其中，n为正整数；所述PAD模块、所述CORE模块、所述PINMUX单元、所述IOCTRL控制单元通过模块例化得到；所述CPU单元用于通过总线对所述IOCTRL控制单元中的寄存器进行配置，从而实现所述IOCTRL控制单元对所述PINMUX单元的控制，在对所述PINMUX单元控制过程中，通过对所述PINMUX单元的端口进行编程，并定义所述PINMUX单元与各IP核的连接通路，从而实现芯片内部IP核端口与所述芯片顶层PAD模块之间的多通路连接。

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