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申请/专利权人：北京工业大学;周欣博
摘要：本发明公开了属于集成电路加密计算技术领域的一种异构动态可重构的近存计算全同态加密加速器。它包括近存全同态加密计算动态可重构硬件和主处理器；近存全同态加密计算动态可重构硬件使用混合内存立方体结构，最底层为异构逻辑层，异构逻辑层上堆叠有多层的存储层,多层的存储层分多个存储区域；异构逻辑层的异构处理单元阵列和通用互连块阵列均可重构且可扩展；主处理器用于对近存全同态加密计算动态可重构硬件进行空间域和时间域的映射配置以及密文数据收发。这种结构可支持对不同全同态加密算法安全参数和数据结构的适配，以及针对不同应用场景的算法结构进行及时的全同态加密方案切换，并执行近存计算以提高数据移动效率。
主权项：1.一种异构动态可重构的近存计算全同态加密加速器，其特征在于：包括近存全同态加密计算动态可重构硬件1和主处理器2；所述近存全同态加密计算动态可重构硬件1使用混合内存立方体结构，其中,最底层为异构逻辑层10,所述异构逻辑层10上堆叠有多层的存储层11,多层的所述存储层11分多个存储区域110；所述异构逻辑层10包括多个Vault控制器100；每个所述Vault控制器100通过穿过硅片的一个高速通道TSV12与一个所述存储区域110连接构成一个Vault；多层的所述存储层11与所述异构逻辑层10通过多个所述高速通道TSV12连接构成多个所述Vault；所述主处理器2根据全同态加密应用算法结构对所述存储层11和所述异构逻辑层10进行空间域和时间域的映射配置；所述主处理器2接收所述异构逻辑层10的密文处理结果。
全文数据：
权利要求：
百度查询： 北京工业大学 周欣博 异构动态可重构的近存计算全同态加密加速器
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