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申请/专利权人：无锡信捷电气股份有限公司
摘要：本发明涉及PLC通信技术领域，具体是一种基于LVDS的PLC通信方法，包括主机模块和至少一个从机模块，所述主机模块包括主机MPU模块和主机FPGA模块，所述主机MPU模块和所述主机FPGA模块之间通过高速并口连接；所述从机模块包括从机MCU模块和从机FPGA模块，所述从机MCU模块和所述从机FPGA模块之间通过高速串口连接；所述主机FPGA模块与所述从机FPGA模块之间，以及相邻各所述从机FPGA模块之间分别通过LVDS总线连接，用于数据的发送与接受。通过建立两条互不干扰的信道，提高数据传输的效率；通过本方案提供的系统结构，各从机能实现同步输出，进而有效解决了时间差的问题。
主权项：1.一种基于LVDS的PLC通信方法，其特征在于，包括主机模块和至少一个从机模块，所述主机模块与各所述从机模块采用菊花链连接；所述主机模块包括主机MPU模块和主机FPGA模块，所述主机MPU模块和所述主机FPGA模块之间通过高速并口连接；所述从机模块包括从机MCU模块和从机FPGA模块，所述从机MCU模块和所述从机FPGA模块之间通过高速串口连接，所述高速串口包括第一高速串口和第二高速串口；所述第一高速串口用于所述从机FPGA模块将下行数据传送给所述从机MCU模块，所述第二高速串口用于所述从机MCU模块将上行数据传送给所述从机FPGA模块；所述主机FPGA模块与所述从机FPGA模块之间，以及相邻各所述从机FPGA模块之间分别通过LVDS总线连接，用于数据的发送与接受；通信流程包括：步骤1所述从机模块确认是否有下行数据的输入，若否，则等待接受；若有，则进入步骤2；步骤2所述从机模块中从机FPGA模块的计数器tick+1；步骤3所述从机模块确认是否有上行数据输出，若否，则进入步骤2；若是，则进入步骤4；步骤4所述从机FPGA模块锁存的计数器tick的值，并计算补偿时间Ti；步骤5从机FPGA模块的计数器tick清零并结束。
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权利要求：
百度查询： 无锡信捷电气股份有限公司 一种基于LVDS的PLC通信方法
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