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申请/专利权人：上海合芯数字科技有限公司;合芯科技有限公司
摘要：本申请提供一种综合后的网表和SDC中基本单元名称匹配方法、系统、终端及介质，通过判断每个基本单元分别在当前电路设计时序约束文件以及综合后的网表中的名称是否一致，以确定具有打散单元的基本单元，再从生成的对应所有打散单元的映射文件中获得具有打散单元的各基本单元的正确名称，并更新至当前电路设计时序约束文件中。通过本申请中的映射文件，使得各基本单元在电路设计时序约束文件以及综合后的网表中的名称保持一致，从而后端工具可以正确读入电路设计时序约束文件，后端设计人员可以进行更加可靠的物理布局布线工作。
主权项：1.一种综合后的网表和SDC中基本单元名称匹配方法，其特征在于，包括：判断每个基本单元分别在当前电路设计时序约束文件以及综合后的网表中的名称是否一致，以确定具有打散单元的基本单元；在综合后的网表中抓取所有打散单元，并根据抓取的打散单元生成对应所有打散单元的映射文件；从生成的所述映射文件中获得具有打散单元的各基本单元的正确名称，并更新至当前电路设计时序约束文件中，以获得供后端工具正确读入的电路设计时序约束文件。
全文数据：
权利要求：
百度查询： 上海合芯数字科技有限公司 合芯科技有限公司 综合后的网表和SDC中基本单元名称匹配方法、系统、终端及介质
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