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申请/专利权人：华中科技大学
申请日：2024-03-28
公开（公告）日：2024-07-05
公开（公告）号：CN118295627A
主分类号：G06F7/535
分类号：G06F7/535;G06F30/32
优先权：
专利状态码：在审-实质审查的生效
法律状态：2024.07.23#实质审查的生效;2024.07.05#公开
摘要：本发明公开了一种SRT除法器迭代模块的参数化设计方法，包括下述步骤：根据输入参数对除法器结构进行判断并确定除法器结构和余数重建模块结构；根据输入参数生成编码器和解码器的算法逻辑；根据输入参数生成选商单元中查表电路的选商表；将所述除法器结构和余数重建模块结构，编码器和解码器的算法逻辑和所述选商表与具体电路设计相结合，构造SRT除法器迭代模块。本发明旨在利用参数化设计构造大量不同配置的SRT除法器迭代模块电路，以满足除法器在各种需求侧重的场景面积，性能，功耗下的具体需要。
主权项：1.一种SRT除法器迭代模块的参数化设计方法，其特征在于，包括下述步骤：根据输入参数对除法器结构进行判断并确定除法器结构和余数重建模块结构；根据输入参数生成编码器和解码器的算法逻辑；根据输入参数生成选商单元中查表电路的选商表；将所述除法器结构和余数重建模块结构，编码器和解码器的算法逻辑和所述选商表与具体电路设计相结合，构造SRT除法器迭代模块。
全文数据：
权利要求：
百度查询： 华中科技大学 一种SRT除法器迭代模块电路的参数化设计方法
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