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申请/专利权人：瑞芯微(北京)集成电路有限公司
申请日：2024-03-15
公开（公告）日：2024-06-28
公开（公告）号：CN118259831A
主分类号：G06F3/06
分类号：G06F3/06
优先权：
专利状态码：在审-公开
法律状态：2024.06.28#公开
摘要：本公开提供控制预取式FIFO的方法、预取式FIFO装置及芯片。所述控制预取式FIFO的方法包括：获取存储器阵列的状态；响应于所述存储器阵列的状态为非空，在FIFO端口接收与某一拍数据相对应的数据弹出使能信号之前，根据输入延迟值将所述存储器阵列中的所述一拍数据预取至流水线寄存器中；基于FIFO端口接收到所述数据弹出使能信号，根据所述输入延迟值确定所述一拍数据在所述流水线寄存器中的位置；以及读取所述流水线寄存器中的所述位置处的预取的所述一拍数据，并将所述一拍数据传输至所述FIFO端口进行数据弹出。本公开提供了一种读空响应的延迟可变的FIFO结构，通过预取和读冲刷的设计，有效保证了读预取功能的准确性。
主权项：1.一种控制预取式FIFO的方法，其特征在于，包括：获取存储器阵列的状态；响应于所述存储器阵列的状态为非空，在FIFO端口接收与某一拍数据相对应的数据弹出使能信号之前，根据输入延迟值将所述存储器阵列中的所述一拍数据预取至流水线寄存器中，所述输入延迟值根据流水线结构而可配置，所述流水线结构被插入在FIFO内部的存储器读数据端到FIFO最终的读数据端之间并且具有可变延迟；基于FIFO端口接收到所述数据弹出使能信号，根据所述输入延迟值确定所述一拍数据在所述流水线寄存器中的位置；以及读取所述流水线寄存器中的所述位置处的预取的所述一拍数据，并将所述一拍数据传输至所述FIFO端口进行数据弹出。
全文数据：
权利要求：
百度查询： 瑞芯微(北京)集成电路有限公司 控制预取式FIFO的方法、预取式FIFO装置及芯片
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