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申请/专利权人：深圳比特微电子科技有限公司

摘要：本公开涉及一种异步桥电路、总线装置和片上系统。该异步桥电路包括：第一异步子模块，所述第一异步子模块用于设置在第一固化域中，且所述第一异步子模块被配置为基于所述第一固化域中的第一时钟频率运行；以及第二异步子模块，所述第二异步子模块与所述第一异步子模块以异步通信的方式相连接，所述第二异步子模块用于设置在第二固化域中，且所述第二异步子模块被配置为基于所述第二固化域中的不同于第一时钟频率的第二时钟频率运行。

主权项：1.一种异步桥电路，其特征在于，所述异步桥电路包括先进先出FIFO异步桥，所述FIFO异步桥包括：写入子模块，所述写入子模块包括写入同步器、写入控制器和FIFO存储器，所述写入控制器被配置为根据所同步的读取指针和写入指针，产生第一存储状态指示信号，并被配置为根据所述第一存储状态指示信号和写入请求信号，产生写入控制信号，其中，在所述第一存储状态指示信号指示所述FIFO存储器处于非满状态且所述写入请求信号指示存在写入请求的情况下，所述写入控制信号指示写入数据，否则，所述写入控制信号指示不写入数据；以及读取子模块，所述读取子模块包括读取同步器、读取控制器和选择器，所述读取控制器被配置为根据所同步的写入指针和读取指针，产生第二存储状态指示信号，并被配置为根据所述第二存储状态指示信号和读取请求信号，产生读取控制信号，其中，在所述第二存储状态指示信号指示所述FIFO存储器处于非空状态且所述读取请求信号指示存在读取请求的情况下，所述读取控制信号指示读取数据，否则，所述读取控制信号指示不读取数据；其中，所述写入子模块和所述读取子模块中的一者用于设置在第一固化域中并被配置为基于所述第一固化域中的第一时钟频率运行，所述写入子模块和所述读取子模块中的另一者用于设置在第二固化域中并被配置为基于所述第二固化域中的不同于第一时钟频率的第二时钟频率运行，且从所述写入子模块向所述读取子模块传输待传数据的传输时间小于或等于所述写入同步器和所述读取同步器中的任一者的同步时间；其中，所述写入同步器与所述读取子模块通信地连接，且所述写入同步器被配置为接收来自所述读取子模块的读取指针，并将读取指针与所述写入子模块所在的固化域中的时钟频率同步；所述FIFO存储器与所述写入控制器通信地连接，且所述FIFO存储器被配置为响应于所述写入控制信号指示写入数据，接收并存储待传数据；其中，所述读取同步器与所述写入子模块通信地连接，且所述读取同步器被配置为接收来自所述写入子模块的写入指针，并将写入指针与所述读取子模块所在的固化域中的时钟频率同步；所述选择器与所述读取控制器和所述FIFO存储器通信地连接，且所述选择器被配置为响应于所述读取控制信号指示读取数据，选择并接收所述FIFO存储器中的待传数据。

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